第30章 调试风暴与“远大”的催促[第1页/共4页]

“我们能不能不寻求最高频次的稳定？”林轩在一次深夜的技术会商会上说道，“弘远的订单是针对低本钱促销市场的，他们对机能的要求一定那么极致。我们能不能找到一个稍低一些的、PLL能够稳定事情的频次点？比如，目标频次是100MHz，我们能不能找到一个在80MHz或90MHz下，统统芯片都能稳定事情的‘甜点’（sweet spot）？”

“我明白。”林轩的声音带着一丝怠倦，但更多的是果断，“我们已经没有退路了。”

找到了病根，就好对症下药了。固然已经流片的芯片没法点窜版图，但顾维钧提出了一个奇妙的“软件赔偿”计划：通过微调DAC内部的某些校准参数，并共同输出端的一个小型RC滤波电路（这个能够在内部测试板上增加），能够在必然程度上按捺这类高频耦合噪声。

林轩亲身坐镇，敏捷建立了三个并行的调试攻关小组，别离由陈家俊（卖力数字逻辑与体系集成）、顾维钧（卖力摹拟电路，主攻音频和PLL）和李志远（卖力操纵EDA东西停止帮助阐发和考证）牵头，集结了公司最精锐的技术力量，开端了争分夺秒、日夜不断的调试风暴。

接着，他们尝试对芯片的摹拟电源和数字电源停止更严格的滤波措置，乃至利用高精度的内部线性电源伶仃为摹拟部分供电，以解除电源噪声的滋扰。成果发明，固然噪声有所减小，但并未完整消逝，申明电源并非独一（乃至不是首要）的噪声来源。

李志远操纵“追光者”STA东西和采办的第三方电路仿真软件，对PLL模块停止了更深切的阐发。仿真成果显现，PLL的环路带宽（Loop Bandwidth）和相位裕度（Phase Margin）在某些工艺角（process corner）和高温前提下，确切处于临界状况，轻易产生振荡或失锁。

颠末两天两夜几近不眠不休的排查和仿真对比，他们终究找到了一个首要的可疑点：在版图设想中，为了节流面积，DAC的输出走线与一组高速切换的数字时钟信号线间隔过近，且地线樊篱做得不敷充分，导致数字时钟噪声耦合到了摹拟输出信号上！

黄耀龙接受着庞大的压力。他既要安抚弘远那边烦躁的情感，又要从技术团队那边获得相对精确的信息。他常常夹在中间，摆布难堪。

他接着弥补道：“同时，我们能够通过优化MP3解码的软件算法（运转在芯片内部的CPU核上），用软件效力来弥补一部分硬件频次的丧失。只要终究能包管流利解码，满足根基的用户体验，或许就能过关？”

这个“降频求稳+软件优化”的思路，让大师面前一亮！

同时，他也再次联络了赵雅凝。此次，是请她帮手核阅与弘远电子的供货条约弥补条目。鉴于首批芯片能够存在的机能颠簸和良率题目，林轩但愿在条约中插手一些免责或协商条目，以降落本身的风险。

“奉告弘远，”林轩对黄耀龙说，“首批样品已经收回，大范围量产正在按打算停止。我们会尽统统尽力，确保在十一月尾前，托付第一批起码一万片的合格芯片！”

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